Hallo, ich habe eine Kommunikation (nur 50 Byte senden) zur Stande gebracht, nun an meinem Logic Analyzer hat jedes Byte andere Timing (ein liegt 6us an, der Nächste 42us etc. s. Anhang). Ich habe bei FTDI angerufen und die behaupten das wäre bekanntes Problem und würden mir per E-Mail was zusenden. Da bin ich jetzt skeptisch da mein Mailbox immer noch leer ist. Wüste jemand wie man diesen Problemchen lösen kann, da ich umbedingt "saubere" Pattern brauche. Freundliche Grüsse, Safi
Safi wrote: > Wüste jemand wie man diesen Problemchen lösen kann, da ich umbedingt > "saubere" Pattern brauche. Das ist schlicht und ergreifend so nicht möglich. Bei USB hast du keinerlei Kontrolle über die zeitlichen Abläufe. Sowas kannst du nur mit einem externem Microcontroller oder so machen.
Hi Christian, Danke für Deinen Antwort. Ich habe gerade einen Antwort von FTDI erhalten: "There is a known issue in silicon with synchronizing the USB clock to the output clock. If you set the baud rate to 3000000 and pad your data stream with extra 1’s and 0’s you will be able to get a consistent pulse width to match your requirements." Danach habe ich tatsächlich die Baudrate zu FT_921600 gesetzt und ...die pattern werden tatsache regelmässig (s. Anhang, habe für SyncBitbang und AsyncBitbang probiert, tut beides). Die Bitrate kann man dann mit "padden" manipulieren ... Danke ich werde jetzt weiter probieren...
Naja, wer USB kennt, weiß, dass das auch nur die halbe Wahrheit ist. Oder verwenden die isochrones Streaming?
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