Hallo, ich brauche ein anständiges Verilog Skript (Vorlesungsskript), englisch oder deutsch ist egal. Ich hab im Internet schon gesucht, aber nur Skripte gefunden die das Thema ziemlich oberflächlich behandeln... Würde mich sehr freuen wenn ihr eure Lieblingslinks zu diesem Thema posten könntet... Dankeschön mfg Tim
dear friend, you can have a look on http://www.asic-world.com/verilog/veritut.html or http://books.google.de/books? ---Verilog: Modeling for synthesis and verification Bernhard Hoppe i hope this would be helpful to u...Regards Manish
Ich habe das gekauft: http://books.google.de/books?id=DxQGrz7q-SwC&printsec=frontcover&dq=Verilog&hl=de&ei=pwSkTfnFLZDXsgaVz4mEBw&sa=X&oi=book_result&ct=result&resnum=2&ved=0CD8Q6AEwAQ Und ein paar Male gelesen... ich habe früher nichts verstanden und es hat geholfen, mindestens ich verstehe jetzt die logik hinter HDL und kann damit arbeiten. Die Beispiele sind nutzlich und bescreibung ist einfach zu folgen. Ich kann es dann empfehlen :)
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