Hallo Leute, besteht bei den externen Interupts des Atmegas zwischen INT3:0 und INT7:4 ein unterschied...? Ich bräuchte Interrupts bei jeder Pegeländerung... Im Datenblatt steht: Bei INT3:0 Any edge of INTn generates asynchronously an interrupt request. Bei INT7:4 Any logical change on INTn generates an interrupt request Bitte um eure Kommentare!
Hi >besteht bei den externen Interupts des Atmegas >... >Bitte um eure Kommentare! Und welche ATMegas meinst du? Ich kenne welche, die gar keine acht externe Interrupts haben. MfG Spess
The External Interrupts can be triggered by a falling or rising edge or a low level. This is set up as indicated in the specification for the External Interrupt Control Registers – EICRA (INT3:0) and EICRB (INT7:4). When the external interrupt is enabled and is configured as level triggered, the interrupt will trigger as long as the pin is held low. Note that recognition of falling or rising edge interrupts on INT7:4 requires the presence of an I/O clock, described in “Clock Systems and their Distribution” on page 39. Low level interrupts and the edge interrupt on INT3:0 are detected asynchronously. This implies that these interrupts can be used for waking the part also from sleep modes other than Idle mode. The I/O clock is halted in all sleep modes except Idle mode.
Hier ist der At90usb1287 gemeint... Ich glaube der Atmega16/64/128 hat auch 8 externe Interrupts! schöne Grüße
Verstehe ich leider noch immer nicht ganz.... 1) Any edge of INTn generates asynchronously an interrupt request. 2) Any logical change on INTn generates an interrupt request Diese 2 Sätze haben für mich die selbe bedeutung. 1.) Jede Flanke generiert einen Interupt 2.) Jede logische Änderung (=Flanke) generiert einen Interrupt.
>Ich glaube der Atmega16/64/128 hat auch 8 externe Interrupts!
Atmega16 drei
ATmega64 acht
Atmega128 acht
Datenblatt lesen bildet. Glauben hilft da nicht;)
Was hat das mit dem zu tun? Ich habe den At90usb1287, und die Frage wurde genau gestellt oder?
Hi >Verstehe ich leider noch immer nicht ganz.... >1) Any edge of INTn generates asynchronously an interrupt request. >2) Any logical change on INTn generates an interrupt request >Diese 2 Sätze haben für mich die selbe bedeutung. Nein. Das wichtige Wort ist 'asynchronously' für INT3:0. Diese Interrupts werden auch in den Sleep-Modes, bei abgeschalteten IO-Clk, ausgelöst. Mit INT7:4 funktioniert das nicht. MfG Spess
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