Hallo, Wir haben hier eine Platine mit FPGA, die mehrere Steckplätze für Erweiterungskarten hat. Zu jeder Erweiterungsplatine gehört ein VHDL-Template. Schön wäre es, wenn man in diesem Template explizit angeben kann, dass der Pin nicht verbunden sein soll. Geht das irgendwie? Praktisch immer gibt es dann nämlich Pins der FPGA, die nicht angeschlossen sind, da nicht alle Erweiterungskarten alle Pins verwenden. Also erscheinen bei jedem synthetisieren unzählige Warnungen wie: bidirect pad net 'pin' has no legal driver Das macht das Warnungsfenster natürlich extrem unübersichtlich. Daher suche ich eine Möglichkeit die Warnung zu deaktivieren, aber eben nur explizit für diese Pins. Am liebsten im Template das zu der Karte gehört. Fest auf 0 oder auf 1 treiben würde ich lieber nicht machen. Damit verschwindet zwar die Warnung, allerdings sind so mehr Leitungen falsch getrieben, wenn sich aus versehen die falsche Erweiterungskarte auf der Hauptplatine befindet. Eine andere Möglichkeit, die mit eingefallen ist, wäre für jeden Steckplatz für jede Karte ein eigenes ucf zu haben. Das ist dann aber überhaupt nicht mehr generisch, gefällt mit daher auch nicht so richtig. Hat jemand eine bessere Idee? Schöne Grüße, Christian
Das hatten wir mal eine Zeit lang. Nachdem ich es nochmal ausprobiert habe weiß ich auch wieder warum wir damit nicht endgültig zufrieden waren. Es erscheint immer noch die Warnung: Signal xyz connected to top level port xyz has been removed. Bekommt man die auch noch irgendwie weg?
Ich glaube an die vielen (großteils unnützen) Warnungen mußt Du Dich gewöhnen. Ich prüfe nach dem Syntheselauf folgendes ab:
1 | Timing Score (nach par) |
2 | Unwanted Latches (WARNING:Xst:737) |
3 | Unassigned signals (WARNING:Xst:653) |
4 | Combinatoric loops (WARNING:Xst:2170) |
5 | Gated Clocks (WARNING:PhysDesignRules:372 [bitgen]) |
Duke
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