Forum: FPGA, VHDL & Co. VHDL-AMS Erfahrungsaustausch


von gnihihihi (Gast)


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Schönen guten Morgen.

Mir ist aufgefallen dass es kaum Erfahrungswerte zum Thema VHDL-AMS in 
diesem Forum gibt.. hat das einen bestimmten Grund (bevorzugt ihr 
SystemC-AMS/Verilog-AMS) oder wieso findet diese mächtige VHDL Obermenge 
noch so wenig Beachtung? Neben der Modellierungsfähigkeit komplexer 
mixed signal Designs sind auch tolle nicht-synthetisierbare Module mit 
sehr sehr nützlichen Monitoring Funktionen innerhalb der 
Simulationsumgebung realisierbar.. es gibt also richtig geniale 
Möglichkeiten.

Ich würde mich über einen Austausch mit euch und euren Erfahrungen sehr 
freuen

von Bürovorsteher (Gast)


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Ich bin vorerst mit der Genialität des normalen VHDL voll ausgelastet.

von Joe (Gast)


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Hi,

was für Tools verwendest Du, um VHDL-AMS zu simulieren ?

Ich denke, die Nicht-Verfügbarkeit von freien Tools ist ein starkes 
Hindernis, um VHDL-AMS zu ergründen.

Joe

von gnihihihi (Gast)


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ich nutze QuestaADMS von Mentor.. simplorer und hamster sind dagegen 
frei verfügbar glaub ich

von Dagobert (Gast)


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Habe mich mal in 2003 de Thema gewidmet. Das ganze kommt nur sehr träge 
ins Laufen. Es gab (und gibt ?) kaum Nutzer und die internationalen 
Foren sind leer. Auf Xing gibt es eines mit 3 einträgen :-)

Ich hatte selber mal eine SPICE-Seite mit Vbuilletin-forum, dass ich 
mangels Interesse in 2005 geschlossen habe.

Ein anderes Forum war das von B&G. Hier gibt es infos dazu:
http://www.bausch-gall.de/

Die dortige SPICE-User-Gruppe ist aber auch schon tot, wie es scheint.

VHDL AMS braucht keine Sau, wie es scheint.

von Duke Scarring (Gast)


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Dagobert schrieb:
> VHDL AMS braucht keine Sau, wie es scheint.
Sieht so aus.

Dafür scheint sich was bei SystemC-AMS zu tun:
http://www.ecsi.org/systemc-ams-day

Duke

von haeh (Gast)


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ich vermute, dass AMS zu wenig Nutzen erzeugt in der Industrie.

Möchte man Schaltungen simulieren: man nimmt SPICE
Möchte man mit Formelmodellen arbeiten: man nimmt Matlab/Simulink

AMS hat imo auch den Riesen-Nachteil, dass die Sprache auch noch von der 
Syntax her bescheuert aufgebaut ist. Wenn man eingearbeitet ist sieht 
man das vielleicht nicht mehr, anders als bei VHDL klingen jedenfalls 
die Konstrukte oft "falschrum" wenn man Spannungen und Ströme 
beschreiben möchte.

von christian ständer (Gast)


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schön an vhdl ams is neben der möglichkeit zur modelierung, dass man in 
seine testbench sehr flexible monitorings einbauen kann.. zb mixed 
signal designs kontrollieren.. direkte zusammenhänge von analogen 
spannungen aus der spice umgebung mit digitalen der vhdl modelle 
abgleichen etc

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