Hallo Guys, Ich bearbeite mein Projekt mit fixed_pkg.Nach der Synthese bei Xilinx10.1 und 12.3 kommen immer 3 Warnungen wegen "fixed_pkg": WARNING:HDLParsers:3350 - "D:/Studium/Studienarbeit/VHDL-Code/TOP_MODUL5/fixed_pkg_c.vhdl" Line 1470. Null range: 0 downto 1 WARNING:HDLParsers:3350 - "D:/Studium/Studienarbeit/VHDL-Code/TOP_MODUL5/fixed_pkg_c.vhdl" Line 1471. Null range: 0 downto 1 WARNING:HDLParsers:3350 - "D:/Studium/Studienarbeit/VHDL-Code/TOP_MODUL5/fixed_pkg_c.vhdl" Line 1472. Null range: 0 downto 1 Kann jemand diese Problem lösen? Danke! Gruß!
1470: constant NAUF : UNRESOLVED_ufixed (0 downto 1) := (others => '0'); 1471: constant NASF : UNRESOLVED_sfixed (0 downto 1) := (others => '0'); 1472: constant NSLV : STD_ULOGIC_VECTOR (0 downto 1) := (others => '0'); fixed_pkg_c.vhdl Package hab ich unter http://www.eda.org/fphdl/ heruntergeladen.
Klaus Falser schrieb: > Downto zählt nach unten, aber 0 bis 1 ist aufwärts gezählt! Klaro? Ja,das hab ich auch so gedacht, aber diese Package ist offiziell gedownloadet,darf man sie ändern?
Manu schrieb: > Ja,das hab ich auch so gedacht, aber diese Package ist offiziell > gedownloadet,darf man sie ändern? Ja. Aber m.E. gibt es von den Packages es auch eine Version (xilinx_11.zip), die mit Xilinx zusammen funktionieren soll. Duke
Duke Scarring schrieb: > Ja. Aber m.E. gibt es von den Packages es auch eine Version > (xilinx_11.zip), die mit Xilinx zusammen funktionieren soll. > > Duke Danke dir! Aber diese Package ist genau bei Version xilinx_11.zip.
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