Forum: FPGA, VHDL & Co. Xilinx Spartan 6 - Takt auf Pin legen


von Sigi (Gast)


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Hallo,

ich möchte meinen Takt direkt auf einen Pin legen um diesen mit dem Oszi 
zu messen. Wie ist dies bei Xilinx möglich. Ich habe was von einem Clock 
Net sog. ODDR2 Gatter gelesen, jedoch weiß ich nicht wie ich dies 
benütze bzw. ob es überhaupt für das Problem relevant ist.
Hier mein Codeauzug:

entity main is
    Port (
  -- Systemtakt
  CLK_100MHZ_IN  : in  std_logic;
  CLK_100MHZ_OUT  : out  std_logic;
  -- Reset
  RESET          : in  std_logic
    );
end main;

architecture behavioral of main is

component CLK_GEN
port(-- Clock in ports
    CLK_IN1           : in     std_logic;
    -- Clock out ports
    CLK_OUT1          : out    std_logic
    );
end component;

begin

CLK : CLK_GEN
port map
   (-- Clock in ports
    CLK_IN1            => CLK_100MHZ_IN,
    -- Clock out ports
    CLK_OUT1           => CLK_100MHZ_OUT
   );

end behavioral;

Der Code generiert Fehler...
Kann mir jemand sagen wie ich dies handeln könnte, doch ODDR2 Clock Net 
um Signal auf Pin zu legen?
Bin für die Hilfe sehr dankbar.

von Anderer Sigi (Gast)


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Und welcher Fehler?
1. Mind. eine Warnung: RESET wird nicht gebraucht.
2. Clock einfach ausgeben ist nicht so prickelnd,
   verwende ein ODDR mit entspr. Beschaltung (Wird
   ausführlichst in den ISE/Help/SW-Manuals/Libs
   unter Spartan6-HDL beschrieben).

von Sigi (Gast)


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Danke, ich dacht es mir schon, dass ich ohne Clock Net nicht geht. Aber 
Danke für den Hinweis ISE/ Help Hinweis.

von J. S. (engineer) Benutzerseite


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Sowas kann man zur Not (wenn es nur ein Pin ist und er keinen Bezug zu 
anderen Signalen haben muss) auch mit einem inversen Takt machen:

Man taktet mit dem ursprünglichen Takt und dem inversen Takt jweils ein 
FF und legt deren Ausgänge auf ein XOR. Das ergibt die doppelte Zahl von 
Flankenwechseln bei jeweils dem halben Takt, also wieder den einfachen 
Takt - meistens allerdings mit einem duty cycle, der nicht mehr genau 
bei 50:50 liegt.

von MLG (Gast)


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J. S. schrieb:
> der nicht mehr genau
> bei 50:50 liegt.


Wieso sollter der nicht bei 50% liegen?

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