Hallo wie gross wird eigentlich ein Design das den Logikbereich eines S-6 LX150 füllt (komplett voll bezüglich LUTs und Register) auf einem 90 nm Die als ASIC? (Nur so grob als vergleich) Zum Vergleich soll angenommen werden, dass alle Hardimplementierten sachen in LX150 nicht verwendet werden (B-Ram, DCM, LVDS usw.)
Das kann Dir nur der Hersteller beantworten, indem er Dein Design durch den Compiler zieht. Die FPGA-tools bilden ja alles auf ihre internen Strukturen ab und blähen Logik so auf, dass es auf die LUTs passt. Im ASIC bist Du da frei. Da das Meiste im FPGA Interconnection ist, dürfte auch das meiste wegfallen. Am Besten du sendest mal eine Netzliste.
Wenn du Zugriff auf ASIC Synthese Tools hast, dann kannst du mal diese 45nm library verwenden und dann auf 90nm hochskalieren http://www.nangate.com/?page_id=22
als bestes BSP für diesen Vergleich ist vermutlich der Bitcoin mining code, Welcher gerade für dieses FPGA gemacht ist und sich nur der ProgLogik im FPGA bedient. (Die höchste Kosteneffizienz für ProgLogik ist auch der Grund warum wir dieses FPGA ausgewählt haben) http://www.ztex.de/btcminer/index.d.html Ich habe die benötigten Verilog sources für die 1 FPGA Version aus der Source dieser HP extrahiert und unverändert im Annhang angefügt. Habe leider hier gerade keine Cadence lizenz. Kann das wer "kurz" durchrattern lassen? Process ist dabei egal, kann ja dann einfach skaliert werden....
user schrieb: > Wenn du Zugriff auf ASIC Synthese Tools hast, dann kannst du mal diese > 45nm library verwenden und dann auf 90nm hochskalieren > > http://www.nangate.com/?page_id=22 hmmm ne gratis 45nm library o_O Für welche prozesse ist die anwendbar? Irgendwelche Erfahrungen? Oder ist sie nur gratis weil niemand sie lizenzieren würde? ^^ Die Faraday 45nm is ja... Ihr kennt ja den Preis...
user schrieb: > Oder hier mal anfragen: > > http://www.onsemi.com/PowerSolutions/content.do?id=16621 Ich denke kaum, dass ich da ne Antwort kriege :D. Oder was würdert ihr als ASIC produdzent sagen wenn da wer n bisschen Verilog code schickt, etwas davon quatscht dass es evt. mal n asic geben wird. Und dann evt. mal 1000stk verkauft werden können. Weil die für eine Offetre das ganze nicht einfach mal so durchrattern lassen können sonder serieus machen müssen, werden die wohl kaum drauf eingegen. Kann ja auch gleich bei TSMC anfragen^^ Ne aber erklär mir doch bitte mal wie du gedenkst eine solche Anfrage zu formulieren, dass sie ne Offerte machen.....
ASIC schrieb: > Weil die für eine Offetre das ganze nicht einfach mal so durchrattern > lassen können sonder serieus machen müssen, werden die wohl kaum drauf > eingegen. In der Regel liefern Dir ASIC-Produzenten sogar Angebote für Chips auf der Basis von Pflichtenheften. Die haben schon ihre Erfahrung, was wie lange dauert und wieviel Chipfläche und Wafer sie benutzen müssen, um eine bestimmte Liefermenge zu erzielen. Ob sie Dir die genaue Chipfläche sagen, weiss ich nicht, aber abschätzen können sie es, wenn sie das Design sehen, die Liefermenge wissen und den Termin. Mit unter bekommst Du sogar kostenlos mit einem Chip eine ganze Menge zusätzliche Fläche geliefert, nämlich die, die sie für einen anderen Kunden mitbenutzt haben, mit dem Du Dein Design teilst. Freilich kennst Du es nicht und kannst es auch nicht nutzen, weil sie es Dir natürlich totgelegt haben und/oder nicht bonden. Da die Chipfläche aber von so vielen Faktoren abhängt (u.a. auch Technologiegrösse, gewünschtes Treiberleistungverhalten) wird Dir so ein Wert auch nicht viel bringen, denke ich. Er ist nicht auf andere Hersteller/Verfahren übertragbar. Was Du machen kannst, ist mal die Altera-Unterlagen in Sachen "Hardcopy" zu studieren. Sowas habe ich mal gemacht. Die kopieren Dir einen FPGA quasi in einen ASIC rein - entsprechende Stückzahlen vorausgesetzt.
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