Forum: FPGA, VHDL & Co. Was passiert mit 'X', 'U', 'H', 'L' usw. bei der Synthese?


von meckerziege (Gast)


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Hi,

wenn man in VHDL einen std_logic_vector verwendet, dann kennt das ja 
anstatt 1 und 0 auch noch andere Zustände wie X U H und L usw.
Synthetisieren lässt sich das auch. Aber wie wird das dann wirlich in 
Hardware umgesetzt bzw. was wird passieren?
Also wenn man ein X zuweist an ein Signal vom typ std_logic, wie muss 
ich mir das dann innerhalb des FPGAs vorstellen?

Danke!

von Hmm (Gast)


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>Also wenn man ein X zuweist an ein Signal vom typ std_logic, wie muss
>ich mir das dann innerhalb des FPGAs vorstellen?

Garnicht. Du überlegst ja auch nicht wo Du auf dem Mond einen Parkplatz 
finden könntest.

von Hmm (Gast)


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Schick die Zuweisung von X mal durch ein Synthesetool, dann sehen wir ob 
Du die Frage noch für sinnvoll hälst.

von user (Gast)


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Also "-" wird als don't care verwendet
"H" "L" "Z" wird bei IO-Zellen verwendet und gibt da 
Pullup/down/tri-state an

Du kannst bei manchen Synthesetools auch interne Tri-State Busse 
beschreiben, die werden dann wärend der Synthese in 
Multiplexerstrukturen umgewandelt

von meckerziege (Gast)


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Hmm schrieb:
> Schick die Zuweisung von X mal durch ein Synthesetool, dann sehen wir ob
> Du die Frage noch für sinnvoll hälst.

Synthese klappt ja soweit!


Hmm schrieb:
>>Also wenn man ein X zuweist an ein Signal vom typ std_logic, wie muss
>>ich mir das dann innerhalb des FPGAs vorstellen?
>
> Garnicht. Du überlegst ja auch nicht wo Du auf dem Mond einen Parkplatz
> finden könntest.

Offenbar gibt es schon Leute die das interessiert: Es war mal explizit 
bei einer Programmieraufgabe gefordert, dass man in einem Fall 'X' 
zuweisen sollte. Gerade gehe ich die Vorlesungsunterlagen nochmal durch 
und mir ists halt aufgefallen und von meinen Kommilitonen wusste es auch 
keiner, was da genau passieren wird.

von Klaus (Gast)


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meckerziege schrieb:
> Hmm schrieb:
>> Schick die Zuweisung von X mal durch ein Synthesetool, dann sehen wir ob
>> Du die Frage noch für sinnvoll hälst.
>
> Synthese klappt ja soweit!

Das es klappt ist eine Sache. Aber du wolltest ja wissen was dabei raus 
kommt. Also den RTL-Viewer anschmeißen und nach schauen :-)

von Lothar M. (Firma: Titel) (lkmiller) (Moderator) Benutzerseite


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meckerziege schrieb:
> Es war mal explizit bei einer Programmieraufgabe gefordert,
> dass man in einem Fall 'X' zuweisen sollte.
Das ist dann aber nur für die Verifikation mit einer Simuletion 
interessant. Die Simulation muss in einem solchen Fehlerfall(!) 
anhalten.

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