Hallo, ich möchte eine Schaltung mit 2 externen Clock-Signalen aufbauen. Beide Signale sind immer aktiv. Einmal soll clk1 den Takt angeben, im anderen Design clk2. Kann ich so etwas mit einem Coolrunner II aufbauen? Oder muss ich die eine (nicht genutzte) Clock physikalisch vom CPLD trennen, so dass sich die Clocks nicht gegenseitig stören? Danke. Klaus
Ein unbenutzer Takteingang stört das CPLD nicht. Lediglich die Stromaufnahme ist ein paar uA höher, weil der Eingangstreiber laufend umgeschaltet wird...
Lothar Miller schrieb: > Ein unbenutzer Takteingang stört das CPLD nicht. Lediglich die > Stromaufnahme ist ein paar uA höher, weil der Eingangstreiber laufend > umgeschaltet wird... Danke, das wollte ich wissen. Alles andere macht ja eigentlich auch keinen Sinn. Bevor ich aber die Schaltung route, wollte ich doch lieber sicher gehen.
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