Quartus / Fehler bei der Compilation (VHDL)

OP #3207494
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Hallo

ich bräuchte mal wieder Eure Hilfe,
Ich versuch mich gerade mit der Quartus Entwicklungsumgebung von 
Alterra.
Die Tutorials von Alterra hab ich mir brav angeguckt und waren auch 
hilfreich. Nun versuche ich ein einfaches (einfachstes) VHDL Programm zu 
compilieren, aber leider klappt dies nicht.

Es kommt immer eine Vehlermeldung (siehe Anhang)

Es wäre echt super wenn mir von Euch jemand weiterhelfen könnte:)

danke im voraus für jeden Ratschlag

mgf



Fehlermeldung

Error (12007): Top-level design entity "My_firs_project_2" is undefined
Error: Quartus II 64-Bit Analysis & Synthesis was unsuccessful. 1 error, 
0 warnings
  Error: Peak virtual memory: 484 megabytes
  Error: Processing ended: Tue Jun 18 11:32:54 2013
  Error: Elapsed time: 00:00:02
  Error: Total CPU time (on all processors): 00:00:01
Error (293001): Quartus II Full Compilation was unsuccessful. 3 errors, 
0 warnings




1
entity BUFFER_1 is
2

3
    port(    INPUT: in bit;
4
          OUTPUT: out bit);
5
          
6
    end BUFFER_1;
7
  
8
  
9
  architecture BEHAVE of BUFFER_1 is
10
  begin 
11
  
12
  OUTPUT <= INPUT;
13
  
14
  end BEHAVE;
Angehängte Dateien:
OP #3207654
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Lothar Miller schrieb:
> Da fehlt irgendwo ein -t- ...

:D ja danke hab mich vertippt, aber das ist ja kein Fehler der einfluss 
auf das Programm hat :D


Lothar Miller schrieb:
> Und: was kommt in jeder VHDL-Beschreibung VOR den Keyword entity?

Hmmmmm :[,  ich lerne gerade VHDL und verwende dabei das veilfach 
empfolene Buch "VHDL-Synthese". Bin da erst auf Seite 30, hab jedoch bis 
jetzt noch nichts vor der entity entecken können ?

vieleicht das? (habs aus nen exampel von Quartus)

library ieee;
use ieee.std_logic_1164.all;


habs mal dazugegeben, aber die Fehlermeldungen bleiben noch :(,

villeicht findet er die lbr ja nicht, oder?

danke
Moderator (Firma: Titel) Persönliche Seite #3207707
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simon hoen. schrieb:
> villeicht findet er die lbr ja nicht, oder?
Nein, "er" findet das Projekt nicht. Du solltest mal dein Projekt NEU 
aufsetzen. Deine Toolchain stochert irgendwo im Trüben. Du hast 
wahrscheinlich mal einen Tippfehler reingebracht.

>> fehlt ein -t-
> :D ja danke hab mich vertippt
Das musst du aber der Toolchain sagen, die sucht nach etwas ohne t ...

> Bin da erst auf Seite 30, hab jedoch bis jetzt noch nichts vor der
> entity entecken können ?
> vieleicht das? (habs aus nen exampel von Quartus)
Ja. Das fehlt garantiert.
Siehe auch http://www.lothar-miller.de/s9y/archives/80-Hello-World!.html
OP #3207912
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Böser Kommunist schrieb:
> Deine top entity soll genauso heißen wie dein Projekt.
> Nenne den Buffer_1 in My_first_project um

danke :):)

habs umbenannt und jetzt compiliert "es" es :)

ne frage was ist aber wenn ich in einem Project mehrere 
entity/architectuer paare hab, man kann doch nich alle entitys gleich 
benennen, wird dann nur die erste wie der Projektname benannt?

danke

mgf
#3208918
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simon hoen. schrieb:
> Wie stellt man das an ?? :)

Im File "MY_PRO.qpf" steht bei mir die Linie:
1
PROJECT_REVISION = "FPGATOP"

Dann gibt es ein File namens "FPGATOP.qsf" wo dann (unter anderem) 
drinsteht:
1
set_global_assignment -name TOP_LEVEL_ENTITY fpgatop

D.h. bei mir sind der Name des .qsf-Files und des Toplevels gleich (ob 
das nötig ist oder nicht weiss ich nicht) aber Projekt (MY_PRO) und 
Toplevel (FPGATOP) definitiv unterschiedlich.
OP #3208985
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Vielen Dank :) :)

hab jetzt die .qsf aufgemacht und an der Stelle

set_global_assignment -name TOP_LEVEL_ENTITY ...
hinten dran meine entity hingeschrieben, abgespeichert und dann hat das 
Compilieren geklappt, von daher muss das .qsf File nicht gleich heißen 
wie die "TOP_entity", bei mir heist sie gleich wie das Project.

Danke für die Erklärung :)

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