Hallo,
ich habe mir mit dem CoreGenerator von Xilinx einen BRAM generiert.
Diesen instanziere ich in zwei verschiedenen entities und benenne die
Instanziierungen auch unterschiedlich.
Ich will also am Ende zwei gleichartige BRAMs haben.
Wenn ich das ganze mit ISIM simuliere bekomme ich folgende Warnhinweise:
1 | WARNING:ProjectMgmt - Duplicate Design Unit 'mybram' found in library 'work'
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2 | WARNING:ProjectMgmt - "G:/Spartan6_test/median4/ipcore_dir/mybram_synth.vhd" line 64 (active)
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3 | WARNING:ProjectMgmt - "G:/Spartan6_test/median4/ipcore_dir/mybram.vhd" line 43
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4 | WARNING:HDLCompiler:685 - "G:/Spartan6_test/median4/ipcore_dir/mybram.vhd" Line 43: Overwriting existing primary unit mybram
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Bei der zweiten Instanziierung ignoriert er dann auch die eingestellte
Vorbelegung des BRAMs mit Nullen und meckert dann, dass er mit Us
rechnen muss...
Synthetisieren lässt sich alles ohne Probleme. Keine Warnung, nicht
einmal eine Info.
Wie kann ich diesen Fehler beheben? Gibt es da irgendeinen Trick?
Vielen Dank für Eure Hilfe.