Hallo Zusammen,
ich habe eine FSM in VHDL geschrieben.
Diese Funktioniert auch richtig, nur sind die Anfangszustände, also
nachdem der FPGA (Microsemi Igloo AGLN250) neu bestromt oder der
Programmcode neu hochgeladen wurde, nicht definiert.
Bei der Synthese bekomme ich außerdem folgendes Warning:
1 | Initial value is not supported on state machine state
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Die FSM initialisierung sieht folgendermaßen aus.
1 | type fsm is (initial_condit, init, idle, ...); -- Def. Zustandsautomat
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2 | signal state : fsm := initial_condit; -- Startzuweisung FSM
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Habt Ihr Beispiele wie man ein solches Problem lösen könnte?
Schon einmal vielen Dank für Eure Antworten.
Grüße