Verilog / Altera De2 Zufallszahlen

[Christian Becker (Gast)]

Hi Leute,

ich hoffe ihr könnt mir ein wenig unter die Arme greifen. Habe die 
letzte Stunde damit verbracht zu ergoogeln, wie man in Verilog 
Zufallszahlen generiert.

Hintergrund ist folgender:

Ich muss für meine BA ein mehr oder weniger Autonomes Modell mit einer 
Modelleisenbahn entwickeln.

Nun bin ich an den Punkt angekommen, andem ich die Weichen zufälllig 
schalten möchte / muss.

Dazu benötige ich eine mehr oder weniger gute Zufallszahlengeneration 
zwischen 1-20.

Jedoch finde ich im Netz nichts, was mal eben so einfach zu 
implementieren wäre (bin Verilog und FPGA Neuling)

Falls mir mal kurz jemand zeigen könnte, wie ich ein möglichst simple 
Zufallszahl generie, wäre ich sehr sehr dankbar.

Vielen Dank schon einmal im Voraus!

[ich (Gast)]

http://de.wikipedia.org/wiki/Linear_rückgekoppeltes_Schieberegister

[Lothar M. (Firma: Titel) (lkmiller) (Moderator)]

Christian Becker schrieb:
> (bin Verilog und FPGA Neuling)
Arbeite daran und ändere das.

> Jedoch finde ich im Netz nichts, was mal eben so einfach zu
> implementieren wäre
http://www.asic-world.com/examples/verilog/lfsr.html

https://www.google.de/search?q=lfsr+verilog

[Christian Becker (Gast)]

Danke für Eure Antworten. Das Beispiel hab ich natürlich auch im Netz 
gefunden und auch so implementiert. Leider funktioniert es bei mir 
nicht. Es spuckt keine Zufallszahlen aus.

Das Problem liegt vermutlich daran, dass ihc nicht weiß, wie ich die 
inputs nun am FPGA verschalten muss.

Die Clock ist klar, was mache ich aber mit data, enable und reset. Ohne 
diese funktioniert der ganze Krempel ja nunmal nicht. Worauf soll ich 
diese im Pin-Planner legen?

Danke für Eure Hilfe!

[Duke Scarring (Gast)]

Christian Becker schrieb:
> Die Clock ist klar, was mache ich aber mit data, enable und reset. Ohne
> diese funktioniert der ganze Krempel ja nunmal nicht. Worauf soll ich
> diese im Pin-Planner legen?

- reset, je nach Polarität auf GND oder VCC
- enable, immer dann aktivieren, wenn Du einen neuen 'Zufallswert' 
brauchst
- data, das dürfte der AUsgang sein, der geht an Deine Weichensteuerung

Üblicherweise wird man die Pins in einem FPGA nicht nach außen führen, 
sondern mit seinem restlichen Design verknüpfen.

Duke