Liebe Kollegen! Ich habe mit Matlab ein VHDL File erstellt (wollte das schon immer ausprobieren). HDLCODE GENERATOR Leider hat das .vhd Design keine Taktflanke dabei. kein!
1 | if clk'event and clk = '1' then |
2 | --...
|
Kann man das irgendwo einstellen, dass Matlab die obige Zeile dazuschreibt??? DANKE! Bussi Sandy