Ich habe angefangen mich mit FPGAs zu beschäftigen. Dabei sind einige Fragen aufgetaucht, die ich nicht endgültig beantworten konnte. Es geht um die Verwendung von Cyclone IV oder Spartan 6 für ein SDR Experiment. Vielleicht könnte ja die eine oder andere von Euch beantwortet werden: 1. Cyclone IV läßt sich nur mit den Altera Bausteinen initialisieren ? (Es ist mir klar, dass das auch ein uP könnte, aber ich möchte nach Möglichkeit die Anzahl der gleichzeitigen Baustellen beschränken) Für Spartan 6 lassen sich beliebige SPI Speicher nutzen ? 2. DDS, CIC, FIR IP-Cores sind bei Xilinx mit dem Webpack verwendbar, bei Altera müssten diese erworben werden (was bei einem Spaßprojekt nicht so toll wäre). 3. 125 MHz Abtastfrequenz sollten für beide Familien kein Problem darstellen. vielen Dank für die Zeit. Wenn jemand ebenfalls Lust auf so eine Geschichte hat, einfach melden. vy 73 Thomas
Hatte ich mir schon mal angeschaut. Wäre evtl. eine Alternative, vor allem preislich. Ganz nett ist auch die HIQSDR Platine http://hiqsdr.com
Thomas S. schrieb: > 3. 125 MHz Abtastfrequenz sollten für beide Familien kein Problem > darstellen. Um mal die Gigahertzen aus der Prozessortechnik zu relativieren: ein Anfänger schafft es recht einfach, auf einem FPGA 125MHz zu unterbieten...
Thomas S. schrieb: > 1. Cyclone IV läßt sich nur mit den Altera Bausteinen initialisieren ? > (Es ist mir klar, dass das auch ein uP könnte, aber ich möchte nach > Möglichkeit die Anzahl der gleichzeitigen Baustellen beschränken) > Für Spartan 6 lassen sich beliebige SPI Speicher nutzen ? 1. Zu Altera kann ich nix sagen, aber Xilinx unterstüzt diverse SPI-Speicher. Eine Liste konnte ich auf die Schnelle nur im Impact finden. > 2. DDS, CIC, FIR IP-Cores sind bei Xilinx mit dem Webpack verwendbar, Ja, aber ich glaube kaum, daß man die "einfach" zusammenklatschen kann und die SDR-Kiste fliegt. > 3. 125 MHz Abtastfrequenz sollten für beide Familien kein Problem > darstellen. Eigentlich nicht. Ich würde auch zu einer fertigen HW/SW-Lösung raten. Zumindest wenn Du in überschaubarer Zeit SDR machen willst. Duke
Moin, stecke da grade nicht tief drin, aber ich würde eine Kombination aus FPGA und DSP empfehlen. Für Filterpipelines habe ich mit den Blackfins gute Erfahrungen gemacht. Wenn man dann an die Grenzen stösst, lagert man die Algos sukzessiv ins FPGA aus. Aber wenn man nicht gleich alles neuentwickeln will, würde ich direkt zu Hardware greifen, die mit GnuRadio irgendwie "from the box" kann. Vorneweg natürlich USRP[2-3], aber es gibt auch wohl inzwischen eine Menge abgespecktere Boards, die ähnlich viel können. Grüsse, - Strubi
Vielen Dank für die Infos. Ich hab im Moment eher interesse an einem ordentlichen Dynamikbereich im Basisband. Ich hab mit dem QS1R bereits einiges erproben können. Dieser hat einen LTC2208 als ADC mit nachfolgendem FPGA. Es wäre ja auch denkbar, dieses Board zu verwenden. Es ist zwar sehr schön, was diese Lösungen mit einem PC zusammen alles kann. Ich hätte einfach gerne eine eigenständige Lösung. Ein PIC32 bzw. STM32F4 kann im Basisband bis zu einigen kHz bereits recht vernünftige Filter rechnen.
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zu 1. auch Altera Cyclone kannst du mit beliebigen SPI Speichern laden, solange sie die passenden Befehle unterstützen, aber das machen eigendl. alle. z.B. hat Spansion auch ein APP-Note dazu: https://www.spansion.com/Support/Application%2520Notes/Configuring_Altera_FPGAs_via_SPI_Flash_AN.pdf
da hat sich ein Fehler in den Link geschlichen: https://www.spansion.com/Support/Application%20Notes/Configuring_Altera_FPGAs_via_SPI_Flash_AN.pdf
Herzlichen Dank. Ich werd mir daraufhin mal andere Bausteine anschauen. Die Spansion Flash Bausteine sind leider inzwischen abgekündigt. Aber andere Väter haben ja auch ganz hübsche .... Hab inzwischen sowohl Cyclone iv als auch Spartan 6 am Blinken und Zählen. Mühsam ernährt sich das Eichhorn :o). vy 73 Thomas
Nimm am besten die M25P Reihe von Micron, die gibts schon ewig und sicher noch lange. Wir haben den Mist mit Atmel durch, Adesto stampft ja alles ein jetzt...
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