Forum: Analoge Elektronik und Schaltungstechnik Probleme mit LDO, Layout Probleme?


von Alex (Gast)


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Hi,
ich habe arge Probleme mit dem LDO TLV70133DBVT von TI. Datenblatt:
http://www.ti.com/lit/ds/symlink/tlv701.pdf

Die wichtigsten Elemente im Schaltplan sowie das Layout (Top und Bottom) 
um den LDO herum befinden sich im Anhang. Um weitere Fragen direkt zu 
beantworten: Die Leiterplatte ist momenten NUR mit der DC Buchse (J1), 
dem LDO (VR1) inkl. Eingangs- und Ausgangskondensator (C1 & C2) 
bestückt. Alle weiteren Elemente sind bis dato nicht verlötet, und der 
Eingang vom LDO sieht direkt die 5V von der DC Buchse. Eine Last am LDO 
ist NICHT angeschlossen, dh er arbeitet im Leerlauf.

Folgendes Problem:
Am Ausgang des LDOs messe ich ca. 4.7V bei einer Eingangsspannung von 
5.1V.

Eine Vergrößerung des Ausgangskondensators auf 4.7uF bringt keine 
Verbesserung.

Sieht jemand auf Anhieb, woran das liegen kann?

Leider habe ich im Nachhinein gesehen, dass TI ein Layout vorschlägt. 
Deshalb habe ich nun bedenken, dass ggf. die Missachtung des 
vorgeschlagenen Layouts das Problem sein könnte.

Oder liegt es daran, dass keine Last angeschlossen ist? Das würde 
allerdings den Angaben im Datenblatt widersprechen.

Ich bin ein wenig ratlos, und bitte daher um Hilfe.

Vielen Dank.

Gruß,
Alex

von Alex (Gast)


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EDIT:
Bottom layer ist GND plane, TOP layer ist +5V.

von mse2 (Gast)


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Die Anschlussbelegung in Deinem Schaltplan widerspricht der im 
Datenblatt:
Schaltplan: GND ist 1
Datanblatt: GND ist 2

von Alex (Gast)


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mse2 schrieb:
> Die Anschlussbelegung in Deinem Schaltplan widerspricht der im
> Datenblatt:
> Schaltplan: GND ist 1
> Datanblatt: GND ist 2

Ach du grüne Neune... Zehn mal drauf geguckt, und zehn mal übersehen. 
Ärgerlich... :(

Aber vielen Dank, ich werde das mal ändern. Vielen Dank für deine Hilfe.

von Tr (Gast)


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Ich versteh dein Layout bzw. Package nicht. Das hat mehr NC Pins als der 
Regler, und wenn er da sitzt wo ich ihn vermute ist OUT und GND 
vertauscht?!

Kannst du ein Foto von der echten Platine machen, oder auf dem 
Screenshot die Pads hervorheben?

von Alex (Gast)


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Oha, jetzt sehe ich meinen Fehler! Ich verwende auf der Leiterplatte den 
TLV704 und NICHT den TLV701.

Ein Blick ins Datenblatt verrät, dass die Pin Belegung der beiden ICs 
verschieden ist, und dass mein Schaltplan mit dem TLV701 übereinstimmt.

Ergo kann das alles gar nicht passen. Problem gefunden und behoben.

Gruß,

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