Forum: FPGA, VHDL & Co. Libero v12.0 synthetisiert nicht


von Markus (Gast)


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Hallo,

ich habe hier ein Problem mit Libero V12.0.
Wie der Titel schon sagt, scheint der synthesizer nicht anzulaufen:
Klicke ich mit rechts im Design Flow auf "Synthesize->Run" dann 
erscheint kurz in der Statuszeile 0% und dann nix mehr. Die roten Kreuze 
im DesignFlow sagen mir eigendlich dass ein Fehler aufgetreten ist, 
leider habe ich aber nirgendwo im Log Fehlermeldungen.

Ich habe zum Test ein ganz einfaches (VHDL basiertes) Projekt aufgesetzt 
(1 Inverter). Der HDL-Check läuft auch durch.
Der Pfad zum Synthesizer ist ok (Tool Profiles) und der Synthesizer 
lässt sich auch manuell starten.


Kann mir jemand sagen, wie ich hier ansetzen kann? Ich kann nirgens im 
Projektverzeichnis Logfiles finden, die ich auswerten könnte.

Vielen Dank,
Markus

von Markus F. (mfro)


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Den Hinweis auf ein nicht vorhandenes File in deinem Screenshot hast Du 
gesehen?

von Markus (Gast)


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Markus F. schrieb:
> Den Hinweis auf ein nicht vorhandenes File in deinem Screenshot hast Du
> gesehen?

Du meinst "new_one.pdc" ? Ja, natürlich. Das war ein Constraintfile das 
ich testweise angelegt hatte und anschliessend wieder aus dem Projekt 
entfernt habe.

von C. A. Rotwang (Gast)


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Markus schrieb:
> Kann mir jemand sagen, wie ich hier ansetzen kann? Ich kann nirgens im
> Projektverzeichnis Logfiles finden, die ich auswerten könnte.

Mal auf den Reiter "Message" drücken ...
Und ggf nach allen files mit änderungszeit in den letzten 5 Minuten 
suchen.
Vor der Synthese das durch den Simulator schicken (i.e. modelsim) der 
macht auch syntaxchecks.

Oder einfach mal ein offizielles Evaldesign runterladen und durch die 
Toolchain jagen bis es läuft. Dann aus den files alles rauswerfen und 
den Invereter einbauen.

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