Bei Xilinx gibt es die IOBUFDS. Damit kann man dynamisch die Datenrichtung einer LVDS-Leitung umschalten. Im Library Guide von Lattice finde ich für den Mach XO2 nur ILVDS und OLVDS: https://www.latticesemi.com/view_document?document_id=52656 Für single-ended Signale kann man BB verwenden, aber für LVDS scheint es das nicht zu geben. Kennt da jemand einen Workaround? Mehrere FPGA sind miteinander verbunden und einer soll ein Taktsignal (via BLVDS) für die anderen zur Verfügung stellen, ohne das ich zwei Designs pflegen will. Duke
Duke Scarring schrieb: > Kennt da jemand einen Workaround? Bei Xilinx und Altera gibt's ja irgendwo im Installationsverzeichnis Verilog- bzw. VHDL-Templates für die Instanziierung und Simulation, teils sehr lowlevel und teils auch nicht in Datasheets dokumentiert. Bei Lattice Diamond ist es (oder war es) glaube ich auch so: da findet man alle möglichen Schablonen. Dein Input-LVDS und der Output-LVDS werden höchstwahrscheinlich auf eine dieser Schablonen aufsetzen. Such einfach mal nach.
Sigi schrieb: > Dein Input-LVDS und der Output-LVDS > werden höchstwahrscheinlich auf eine dieser Schablonen aufsetzen.
1 | COMPONENT ILVDS |
2 | PORT( |
3 | A : IN std_logic := 'X'; |
4 | AN: IN std_logic := 'X'; |
5 | Z : OUT std_logic |
6 | );
|
7 | END COMPONENT; |
8 | attribute syn_black_box of ILVDS : Component is true; |
9 | attribute black_box_pad_pin of ilvds : component is "a,an"; |
10 | --
|
11 | COMPONENT OLVDS |
12 | PORT( |
13 | A : IN std_logic := 'X'; |
14 | Z : OUT std_logic ; |
15 | ZN : OUT std_logic |
16 | );
|
17 | END COMPONENT; |
18 | attribute syn_black_box of OLVDS : Component is true; |
19 | attribute black_box_pad_pin of olvds : component is "z,zn"; |
Das ist leider nicht so ergiebig. Es endet alles in einer Blackbox und nicht in einer konfigurierbaren IO-LVDS-BUFT-Component. Die INRDB und LVDSOB sind für den 'Dynamic Bank Controller'. Damit lassen sich wohl die LDVS-Bänke zur Laufzeit ab- oder zuschalten, um Strom zu sparen.
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